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精通Verilog RTL,熟悉C++, system Verilog,Perl/Python等脚本语言; 精通 UVM等验证方法学; 熟悉数字信号处理和MATLAB,常见接口电路或者SOC架构; 良好的沟通和表达能力,对细节的掌握能力,团队合作精神。 1、参与设计工作,协助设计人员完成设计规范; 2、制订验证方案与计划,编写相关文档; 3、负责芯片级和模块级的验证环境搭建; 4、负责实施验证仿真工作,编写验证报告 |
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66560,张**,2026-3-26 17:06:52
31635,左**,2026-3-25 9:42:08
31635,左**,2026-3-25 9:42:08
58100,赵**,2026-3-25 8:06:20
58100,赵**,2026-3-25 8:06:18
58100,赵**,2026-3-25 8:06:10
58100,赵**,2026-3-25 8:05:46
58100,赵**,2026-3-25 8:05:28
58100,赵**,2026-3-25 8:04:21
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